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IM5116D2DDBG-25

Name: Intelligent Memory IM5116D2DDBG-25
Brand: Intelligent Memory
SKU: 822-IM5116D2DDBG-25
Price: 3.16 CHF
Availability: OutOfStock

Bilder dienen lediglich der Veranschaulichung und sind nicht Originalgetreu
Siehe Produktspezifikationen

Mouser-Nr.:

822-IM5116D2DDBG-25

Herst.- Nr.:

IM5116D2DDBG-25

Herst.:

Intelligent Memory

Beschreibung:

DRAM DDR2 512Mb, 1.8V, 32Mx16, 400MHz (800Mbps), 0C to +95C, FBGA-84

Datenblatt:

IM5116D2DDBG-25 Datenblatt

ECAD Model:

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Produktattribut	Attributwert	Attribut auswählen
Hersteller:	Intelligent Memory
Produktkategorie:	DRAM
RoHS:
Typ:	SDRAM - DDR2
Speichergröße:	512 Mbit
Datenbus-Weite:	16 bit
Maximale Taktfrequenz:	400 MHz
Verpackung/Gehäuse:	FBGA-60
Organisation:	32 M x 16
Zugangszeit:	400 ps
Versorgungsspannung - Min.:	1.7 V
Versorgungsspannung - Max.:	1.9 V
Minimale Betriebstemperatur:	- 40 C
Maximale Betriebstemperatur:	+ 95 C
Serie:	IM5116D2
Verpackung:	Tray
Marke:	Intelligent Memory
Land der Bestückung:	Not Available
Land der Verbreitung:	Not Available
Ursprungsland:	TW
Feuchtigkeitsempfindlich:	Yes
Montageart:	SMD/SMT
Produkt-Typ:	DRAM
Verpackung ab Werk:	209
Unterkategorie:	Memory & Data Storage
Versorgungsstrom - Max.:	90 mA
Gewicht pro Stück:	154 mg

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Datenblatt

IM5116D2DDBG-25 Datenblatt

CAHTS:: 8542320020
USHTS:: 8542320028
MXHTS:: 8542320299
ECCN:: EAR99

Dynamic Random Access Memory (DRAM)

Intelligent Memory Dynamic Random Access Memory (DRAM) includes a full range of JEDEC-compliant DRAMs and ECC DRAMs (SDRAM, DDR, DDR2, DDR3, DDR4, LPDDR4). From an application's point of view, these components work like a monolithic device. The DRAM devices allow for maximum levels of memory density without altering existing board layouts or designs.

Double Data Rate 2 (DDR2) SDRAM

Intelligent Memory Double Data Rate (DDR2) Synchronous DRAM (SDRAM) are eight-bank devices that achieve high-speed data transfer rates. Interleaving the eight memory banks allows random access operations faster than standard DRAMs. A chip architecture prefetches multiple bits and then synchronizes the output data to a system clock. All control, address, and circuits are synchronized with the positive edge of an externally supplied clock. In a source-synchronous manner, I/Os are synchronized with a pair of bidirectional strobes. A sequential, gapless data rate is possible depending on the device's burst length, CAS latency, and speed grade.