TMS320C5532AZAYA05

Texas Instruments
595-S320C5532AZAYA05
TMS320C5532AZAYA05

Herst.:

Beschreibung:
Digitale Signalprozessoren und Controller - DSP, DSC Low power C55x fixed point DSP- up to 10

Datenblatt:
ECAD Model:
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2.74 CHF 3 068.80 CHF
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Texas Instruments
Produktkategorie: Digitale Signalprozessoren und Controller - DSP, DSC
RoHS:  
DSPs
C55x
1 Core
50 MHz
BGA-144
64 kB
64 kB
1.05 V
TMS320C5532
SMD/SMT
- 40 C
+ 85 C
Tray
Marke: Texas Instruments
Land der Bestückung: Not Available
Land der Verbreitung: Not Available
Ursprungsland: PH
ROM-Datengröße: 128 kB
Entwicklungs-Kit: TMDX5535EZDSP
I/O-Spannung: 1.8 V to 3.3 V
Anleitungsart: Fixed Point
Schnittstellen-Typ: I2C, I2S, SPI, UART
Feuchtigkeitsempfindlich: Yes
Anzahl der Timer/Zähler: 3 x 32 bit
Produkt-Typ: DSP - Digital Signal Processors & Controllers
Verpackung ab Werk: 160
Unterkategorie: Embedded Processors & Controllers
Versorgungsspannung - Max.: 1.15 V
Versorgungsspannung - Min.: 998 mV
Watchdog-Timer: Watchdog Timer
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Ausgewählte Attribute: 0

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USHTS:
8542310035
TARIC:
8542319000
ECCN:
3A991.a.2

Prozessoren

Texasinstruments Prozessoren bieten ein umfassendes Portfolio, bewährte Software und weltweite Unterstützung und ermöglichen branchenführende Lösungen in der Automobilindustrie und der Industrie. TI widmet sich der Entwicklung und Optimierung der Prozessoren von heute, um die Intelligenz, die Leistung und die Kostenanforderungen in Automobil-und Industrieapplikationen von morgen zu erreichen. Skalierbare Hardware-und Software-Plattformen mit gemeinsamen Code ermöglichen Entwicklern die nahtlose Wiederverwendung und die Migration über Geräte hinweg, um die zukünftigen Investitionen zu schützen.

TMS320C553x Fixed-Point DSPs

Texas Instruments TMS320C553x Fixed-Point Digital Signal Processors (DSPs) are designed for low-power applications and based on the TMS320C55x DSPC55x DSP generation CPU processor core. The architecture achieves high performance and low power through increased parallelism and total focus on power savings. TI TMS320C553x DSPs support an internal bus structure composed of one program bus, one 32-bit data read bus and two 16-bit data read buses, two 16-bit data write buses, and additional buses dedicated to peripheral and DMA activity. These buses provide the ability to perform up to four 16-bit data reads and two 16-bit data writes in a single cycle.

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